C645x的串行RapidlO息线通信系统设计

3 系统软件设计

RapidIO总线的设置有3个步骤：

①设置RapidIO的时钟，通过SERDES_CFG_CNTL寄存器设置数据收发的速率；

②使能RapidIO的接收器，同时设置一些和数据接收相关的参数，包括差分信号的自适应均衡设计、相位偏差设置、信号损耗设置等；

③使能RapidIO的发送器，同时设置一些和数据发送相关的参数，包括发送速率、总线宽度等。

设置RapidIO速率为3．125 Gbps，使能接收器和发送器的代码如下：

开始和结束都是由主机发起和控制的，从机被动地接收命令并执行指令。当从机需要主动向主机发送数据时，只能由从机发出中断到主机；主机响应中断后，发出数据读取命令。具体的工作流程如图5所示。主机的命令发起机构发出操作命令，并将发送请求包经过命令传输机构传送到从机的命令执行机构，从机的命令执行机构可能执行数据接收(主机向从机发送数据)和数据发送(主机要求从机发送数据)任务。命令执行机构处理完成相应命令，发送应答包到主机，主机判断到命令完成，将命令状态清除，完成整个命令的操作。

RapidIO在数据传输过程中，可能产生错误。根据错误情况，RapidIO发出2种不同的中断到CPU：状态错误，此时CPU应复位或者重新同步RapidIO；严重错误，此时CPU应复位所有和RapidIO相关的设备。CPU进行相应处理后，RapidIO就可以正常通信了。

4 总 结

本文介绍了DSP中的串行RapidIO总线，详述了该总线的层次结构和内部结构，并且结合多个DSP之间的RapidIO通信介绍了硬件和软件系统设计。该总线可以实现10 Gbps的高速数据通信，可以满足语音、图像和数据等多种通信业务的需求。整个通信系统连接简单、通信可靠、实用性强。

作者：汪安民 张胜波 来源：单片机与嵌入式系统