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RMII模式以太网PHY芯片DP83848C的应用

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2.6 CRS_DV——载波侦听/接收数据有效

当接收介质处于非空闲状态时,由PHY来确认CRS_DV。在载波检测中,CRS_DV依据与工作模式相关的标准异步确认。10BASE_T模式下,静噪通过时发生该事件。在100BASE-TX模式,当10位中检测到2个非相邻的零值时,发生该事件。

在RMII规范(1.2版)中提到,载波丢失将导致与REF_CLK周期同步的CRS_DV解除确认,这在RXD[1:O]半字节的首两位出现(即CRS_DV仅在半字节边界解除确认)。在CRS_DV首次解除确认后,如果DP83848C还有数据位要加在RXD[1:O]上,则在REF_CLK周期中,DP83848C应在每半个字节的第2个双位上确认CRS_DV,并在一个半字节的第1个双位解除确认。这样,从半字节边界开始,到CRS(载波侦听/接收信号)在RX_DV前结束时,CRS_DV以25 MHz(100 Mbps模式)或2.5MHz(10 Mbps模式)的频率翻转(假设当载波事件结束时DP83848C还有待传送的数据位)。

通过编程DP83848C能够与RMII规范(1.0版)很好地兼容。在该模式下,CRS_DV将会异步地与CRS进行确认,但是要等传送完最后的数据时才会解除确认,CRS_DV在数据包的末端不会被翻转。该模式虽然不能对来自CRS_DV的CRS信号进行精确的恢复,但是却可以使MAC层的设计更简单。

在出错的载波活动时间中,CRS_DV保持确认。一旦确认CRS_DV,则可以认为在RXD[1:O]上的数据是有效的。然而,由于CRS_DV的确认相对于REF_CLK是异步的,因而在正确解码接收信号之前,RXD[1:0]上的数据应为"00"。

2.7 RX_ER——接收错误

遵照IEEE802.3标准的规定,DP83848C提供一个RX_ER输出端。RX_ER可以维持一个或更多的REFCLK周期,来标识一个在当前PHY到帧的传输过程中曾出现的错误(MAC子层不一定能检测到,但PHY可以检测到的编码错误或其他错误)。RX_ER的变化相对于REF_CLK是同步的。

由于DP83848C是通过以固定数据代替原来数据的方式干扰到RXD[1:O],所以MAC不需要RX_ER,而只需CRC校验(即奇偶校验)就可以检测到错误。

2.8 冲突检测

RMII不向MAC提供冲突标志。对于半双工操作,MAC必须从CRS_DV和TX_EN信号中产生它自己的冲突检测。为了实现这一点MAC必须从CRS-DV信号中恢复CRS信号,并和TX_EN进行逻辑与。注意,不能直接使用CRS_DV,因为CRS_DV可能在帧的末端触发以标志CRS解除确认。

3 RMII模式配置

DP83848C的RMII模式配置包括硬件和软件两个方面。

3.1 硬件配置

如图2所示,DP83848C的X1(34)脚上提供50 MHzCMOS电平的振荡信号。在上电和复位时,强制DP83848C进入RMII模式。方法是通过在RX_DV/MII_MODE(39脚)接入一个上拉电阻。

3.2 软件配置

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PHY的软件初始化流程如图7所示。

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结语

DP83848C配合RMII标准接口提供了一种连接方案,可以减少MAC至PHY接口所需要的引脚数目。该方案使得设计工程师在保持IEEE802.3规范中所有特性的同时,降低系统设计成本。正因为如此,DP83848C能够更好地适应工业控制和工厂自动化,以及通用嵌入式系统等应用场合。

来源:维库开发网

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