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用矢量旋转求解平方根的算法及其FPGA实现
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，有，所以迭代运算时寄存器中存放的上一次旋转所得的坐标值xi，yi每次右移5位。VR算法的FPGA实现架构如图2所示。
(3)后处理单元
由VR算法得到的结果需要经后处理单元处理成单精度浮点数据格式后输出。该单元需要预处理单元传递相关参数。
实验结果
在Quartus Ⅱ6.0环境下使用VHDL语言完成了上述算法，并在Stratix系列EP2S60开发板上实现。时钟频率为100MHz，综合和布局布线后，需要不到1%的ALUT和56个寄存器，因此实现该算法只需要占用很少的资源。仿真波形如图3所示。
来源：电子产品世界
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