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Virtex-5 FPGA设计Gbps无线通信基站设计
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Virtex-5系列FPGA集成100Mbps–6.5Gbps的高性能收发器，配合FPGA内部编程实现的串行RapidIO逻辑层模块可以实现芯片间和板间高性能的数据交换互连。集成符合IEEE 802.3标准的10/100/1000Mbps以太网MAC硬核，连接外部GE PHY或直接使用FPGA本身的GTP/GTX，就可以实现高性能的千兆以太网接口。
算法对资源的需求及FPGA型号的确定
分析Gbps算法链路中各算法的不同实现特点并对运算量以及使用的主要资源进行估计，可以确定所需要使用的FPGA。表1是资源需求估计与FPGA选择的结果，表2是目标FPGA内部资源情况的总结。
表1 Gbps无线通信基站系统算法链路对FPGA资源的需求
来源：维库开发网
