实时视频采集系统的SDRAM控制器设计

0 引 言

在PAL→VGA的实时视频采集系统中，由于视频数据流的数据量大、实时性要求高。需要高速大容量的存储器作为图像数据的缓存。SDRAM作数据缓存不仅具有大容量和高速度的特点，而且在价格和功耗方面也占有很大的优势。但是SDRAM控制较复杂，需要处理预充、刷新、换行等操作，因此有必要设计SDRAM控制器来完成和SDRAM的接口。并且为了保证数据流的连续性，实时视频采集系统通常采用通过对两片SDRAM的乒乓操作来完成图像数据的缓存。针对SDRAM是高速设备，工作频率上限最高可以达到166 MHz，而该系统中前端图像采集模块的像素时钟为27 MHz，后端VGA显示的像素时钟为31．5 MHz。在此介绍了一种使用1片SDRAM的不同BANK进行乒乓操作，且相对容易实现的SDRAM控制器设计方法。

1 SDRAM基本操作原理

SDRAM的主要操作包括初始化、读写访问、刷新、激活、预充电等。以MICRON公司的MT48LC4M3282(1M×32 b×4 BANKS)为例，简要介绍一下SDRAM的操作。

如图1所示，SDRAM的初始化操作过程如下：

(1)在电源管脚上电(电压不得超过标称值的0．3 V)并且时钟稳定后经过200μs延迟，执行一次空操作命令(该命令在延迟周期的后期发出)且保持时钟使能信号为高；

(2)对所有的BANK进行预充电，所有的BANK都进入空闲状态；

(3)预充电后执行两个自动刷新命令，等待八个刷新周期完毕；

(4)发出模式设置命令来设置模式寄存器。由于上电后模式寄存器的状态是不确定的，所以在进行SDRAM操作之前一定要先设置模式寄存器。模式寄存器设置值如图2所示。

对SDRAM的读写访问先要以激活命令选择具体的BANK和行，地址线BA1／BA0用来选择BANK，A0～A11用来选择所要访问的行；然后发出读或写命令，地址线A0～A7用来选择所要访问的起始列。在读命令发出后，要等待一个CAS延迟时间，有效数据才会出现在数据总线上，CAS延迟时间可以设置为2或3个时钟。在写命令发出后，不需要等待CAS延迟时间有效数据会立即出现在数据总线上。对SDRAM的读写操作一般以突发模式进行，突发长度可以设置成1，2，4，8以及全页，常用的长度为8个。该系统的CAS延迟时间设置为2，突发长度为1。

作者：张文涛 王琼华 李大海 张映权   来源：现代电子技术