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5 Gsps高速数据采集系统的设计与实现

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3 结束语
采用FPGA作为数据采集系统的控制核心,使用FPGA内部资源或者外部DDR3实现数据的缓冲存储,充分利用系统资源,便于调试和修改。实现了5 Gsps实时采样率、8 bits采样精度的高速实时数据采集系统。在完成电路的软件和硬件设计以后,通过对ADC和时钟进行测试以及上位机控制界面采集信号的波形显示,结果表明该系统可以稳定地工作,满足设计要求。

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