输出匹配网络是将50欧姆的负载匹配到Ropt,匹配后的阻抗是实部为

做开发还是做研究？

看一下steve cripps的power amplifier一书，里面详细讲了PA的原理和设计
匹配的Ropt会带有一点虚部，因为晶体管有寄生电容

做一个大的作业阿

那就随便忽悠几句，因为后面有格直电容，所以要成感性
或者说因为有电感供电，所以要成容性

在哪能找到那本书啊，谢谢

先把laod line理论搞清楚

如果你是在做CMOS的作业，比如清华池老师的大作业，Ropt就是负载线理论计算出的值，是个实数，输出匹配网络就是将50欧姆匹配到这个实数的Ropt。我和池老师讨论过，他说他们实际做CMOS PA就是这样做。
实际上，最佳负载阻抗应该是Zopt，一个复数阻抗，可以用Load-pull测试的方法得到。比如在设计比较高频率的MMIC时，通常会在片测试Load-pull，并经过去嵌入等处理之后得到Zopt。

是的，看了Cripps的书：如果器件是理想的电流源，那么Zopt就是一个实数的值；但实际器件都存在寄生电容，所以Zopt实际上是一个复数，并且虚部是正数--感性，以吸收寄生电容。
以前我们的在片Load-pull测试也证明了以上结论。但是，前天我测了我们新流的一批管子，发现一个比较奇怪的问题：
1. 4GHz： Zopt=44.6502+34.4645j;
2. 6GHz:  Zopt=10.6537-14.1309j;
3. 8GHz:  Zopt=101.3300+46.057j。
在6GHz的时候，Zopt的虚部是负数--容性，而且我测了同一个Wafer上不同区域大概30多个管子，基本都是这样，以前从来没有见过。
哪位仁兄能解释一下？

呵呵，谢谢！

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