CST中的bondwire的问题

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最近使用CST仿真CMOS芯片中的传输线耦合问题的时候，使用CST所提供的bondwire作为连接线。但是发现在耦合输出的时候bondwire几乎没有输出，请大家帮我看看，有什么错误，还有如何设置接地端，谢谢。
附件：1.CST仿真电流分布图（其中选择侧面两个端口作为激励端口）
2.电路原理图

这个问题觉得蛮有意思的
看了图片后想问下：
1 你设的边界条件是什么这个估计对接地的影响是蛮重要的
2 可否具体的给出问题的条件，物理模型的建立是否用bondwire就能完全建立
我的mail: worklab_cst@163.com

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