cadence中ahdlLib里的adc_8bit_ideal
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请问cadence中ahdlLib里的adc_8bit_ideal如何使用，像它的Vin,Vclk该怎么设置?
类似这种由代码行为建模的器件有没有说明书?
谢谢
类似这种由代码行为建模的器件有没有说明书?
谢谢
在新建的schematic中调用ahdlLib中相应cell的symbol，然后像正常电路一样加上相应的激励就行了。
vin的设置和ref有关系，ref是可以在属性中修改，与修改mos管尺寸的方法是一样的。
至于说明书，可以读一读相关veriloga的代码。
谢谢，解决了，原来是symbol属性里的Vref设置的不对
学习了。
我想请问下小编Vref Vclk 和 Vin 应该如何设置，才能让这个理想ADC模型正常工作?
等答案中......
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