芯片反向设计电路整理和分析要怎么做
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希望有经验的大牛给下指导。网表提取用的是analyzer 整理用的是chiplogic master。现在毫无头绪，无从下手。第一次做走了很多弯路。
可以的话留下联系方式。
可以的话留下联系方式。
在MASTER里放大间距后导入到CADENCE里整理吧，
用过analyzer。master现在用的比较少了，分析都用designer
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