verilog转veriloga

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有一段verilog代码如下:
  for(v=0;v<20;v=v+1)  
       begin

TXD=16'hbcbc;
         TKLSB=1;
         TKMSB=1;
#8;
TXD=16'hfbfb;
         TKLSB=1;
         TKMSB=1;
#8;
       end

求问用veriloga怎么表达?

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