verilog-a语法问题，求解决
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上面是我在一个PPT上找到的一个8-bit ADC的verilog代码，但是一直有错误，
请懂的大神看下。谢谢！
把i声明为genvar i 试试；
不得行啊，改为genvar后会出现这个错误。
bits直接改成8试试，我以前遇到过，忘了，只是猜测
还是同样的问题，对了，你有8-bit adc 的verilog-a代码吗?我是用来仿真DAC的。作为激励信号源。我的QQ，1499882004.方便的话qq交流。
还是同样的问题。对了，你有8-bit ADC verilog-a代码吗?我是为了仿真DAC。作为激励信号源，方便的话QQ交流。1499882004
谢谢！
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