veiriloga和spectre混和需要用混合信号仿真吗？
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veiriloga和spectre混和需要用混合信号仿真吗?还是直接仿就行
我做了一个DAC，调用了一个veriloga的标准ADC元件在前面先把一个模拟信号数字化给DAC当输入测试。
我做了一个DAC，调用了一个veriloga的标准ADC元件在前面先把一个模拟信号数字化给DAC当输入测试。
不用，analoga本身就是模拟的。直接仿即可
用hierarchy生成config电路，将你需要用模型替换的电路用veriloga替换。仿真器选spectre就可以了
不用混合信号仿真的
直接analog下就可以
是哦。。
要混合吧！
这个直接仿真就行了吧
analog design environment里面，session->environment设置调用调用顺序为veriloga spectre ...
spectre 可以直接用veriloga
可以如楼上据说调整view的顺序
或者建config指定使用的view
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