关于LVS时出错
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用assure作LVS时，提示有如下图所示：
但是我检查过版图中PIN的添加和电路原理图相比没有错误，而且相应版图与电理图中电容和电感的值也是一样的，为什么它会提示这个错误呢?求教各位了！
这是什么工具?
用的CADENCE下的"Assure" 验证工具
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