用dracula做lvs遇到cdl导出问题
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用dracula做lvs遇到cdl导出问题：我之前画好电路图能导出，后来修改了下其中的cell结果就导不出来了，纳闷。我导的是模拟的深入到mos管级的 谁能告诉我为什么呢 求助高手啊
貌似这个问题非高手搞不定啊 呵呵 遇到的人较少
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