请教 相位裕度的问题
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请问: 开环仿真相位裕度时, vsin 怎么设置?
如果是纯粹开环的话,可以如此:
vac vinp vinn dc=0 ac=1
vdc vinn gnd dc=vcc/2
.ac dec 10 1 1E=9
不是十分赞同楼上的回答。应为这样的配置没有给输出端一个直流工作点,输出端处于未定义的状态,那么如果开环增益很大的话,而且内在的输入失配也在模型中的话,那么输入端就会飘到电源或者地上去了,什么都仿真不出来。工业界最常用的方法是从输出端引出的连线接到一个低通滤波器上,低通滤波器的另一端接回放大器的输入端。这个滤波器的截至频率可以设在DC (< 1Hz), 那么在满足直流工作点的同时,交流信号也给彻底过滤掉了,是一个很好的开环分析电路配置。如下的电路配置中,vout的直流工作点也设置在了vcc/2的点上。
vac vinp vinn dc=0 ac=1
vdc vinn gnd dc=vcc/2
R_fb vout vinn 1e9
C_fb vinn gnd 1e-3
.ac dec 10 1 1E=9
直接加AC=1的交流信号源就可以了啊
如果只是单纯的前仿真,直接AC就好了,如果有后提取参数,amodaman说得有道理
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