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使用Make reuse时提示出错(图)
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如图,我选定了已经布局好的整块电路版图,然后鼠标右键选择make reuse,弹出如下提示,但是我看不懂,求高人指点:
然后我点击report,内容见下面,好像是提示坐标(0,0)处Board Outline 有问题??1 Drafting, including
1 Board Outline这个是啥意思??
求高人指点迷津!
Board Outline 是板框 去掉板框试试看。
report有两个文件的,另一个是.err文件,你把那个文件上传,我给你找出问题。还有,你自己检查下Part Types,Decal Types,Value,Tolerance,这4个参数要一致才能用,特别是Tolerance,自己建元件库,默认是没这个参数的,要加上
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