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DDR2的布线问题 请指教
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DDR2的数据线布线时是不是只要保证同一字节内DQDQS线等长就可以了？
两层板的话，包地很重要。
一般高频率的板子走等长。
clk/clkb差分线长度小于4000mil所有地址及控制信号长度相差范围+/-750mil同byte lane DQS/DQM within +/-200miltrace 阻抗60ohm+/-10%trace 与trace间距保持3倍线宽，有效抑制串扰。（另外一种做法，如top to ground厚度为5mil，则trace间距至少为15mil。）DDR2基本上不会做两层板。
谢谢楼上两位兄台！
同一字节同层？很难做到呢。
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