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从ＬＯＧＩＣ导网络表到ＬＡＹＯＵＴ后，有个别原件却没有与原
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从ＬＯＧＩＣ导网络表到ＬＡＹＯＵＴ后，有个别原件却没有与原理图对应连接，返回原理图查看时该元件有连接，这是为什么呢？请高手指点！先３Ｑ！
库中CAE与封装的脚位不对应
制作的元件库不规范，容易出现以上情况
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