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高速 ADC 的电源设计
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作者：Thomas Neu，德州仪器 (TI) 系统与应用工程师
系统设计人员正面临越来越多的挑战，他们需要在不降低系统组件（例如：高速数据转换器）性能的情况下让其设计最大程度地节能。设计人员们可能会转而采用许多电池供电的应用（例如：某种手持终端、软件无线设备或便携式超声波扫描仪），也可能会缩小产品的外形尺寸，从而需要寻求减少发热的诸多方法。
极大降低系统功耗的一种方法是对高速数据转换器的电源进行优化。数据转换器设计和工艺技术的一些最新进展，让许多新型 ADC 可以直接由开关电源来驱动，从而达到最大化功效的目的。
系统设计人员们习惯在开关稳压器和 ADC 之间使用一些低噪、低压降稳压器 (LDO)，以清除输出噪声和开关频率谐波（请参见图 1）。但是，这种干净的电源设计的代价是[url=]高[/url]功耗，因为 LDO 要求压降余量来维持正常的运行。最低压降一般为 200 到 500mV，但在一些系统中其可以高达 1 到 2V（例如，ADC 的3.3-V 电压轨产生自一个使用 LDO 的 5V 开关电源时）。
图1从传统电源转到最大功效电源
就一个要求 3.3-V 电压轨的数据转换器而言，300mV 的 LDO 压降增加约 10% 的 ADC 功耗。这种效应在数据转换器中得到放大，因为它具有更小的工艺节点和更低的电源电压。例如，1.8V 时，相同 300-mV 压降增加约 17%（300 mV/1.8 V）的 ADC 功耗。因此，将该链的低噪声 LDO 去除可以产生巨大的节能效果。去除 LDO 还可以降低设计的板级空间、热量以及成本。
本文阐述了包括超高性能 16 位 ADC 在内的一些 TI 高速 ADC 可在 ADC 性能无明显降低的条件下直接通过开关稳压器驱动。为了阐述的方便，我们对两款不同的数据转换器（一款使用高性能BiCOM 技术（TI 的ADS5483），另一款使用低功耗CMOS 技术（TI 的ADS6148）进行了开关电源噪声敏感性研究。本文的其他部分对所得结果进行了一一介绍。
BiCOM 技术—ADS5483
这种工艺技术实现了宽输入频率范围下的高信噪比 (SNR) 和高无杂散动态范围 (SFDR)。BiCOM 转换器一般还具有许多片上去耦电容和非常不错的电源抑制比 (PSRR)。我们对 ADS5483 评估板 (ADS5483EVM) 进行了电源研究，其具有一个使用 TI TPS5420 开关稳压器 (Sw_Reg) 的板上电源；一个低噪声 LDO（TI 的 TPS79501）；以及一个外部实验室电源使用选项。我们使用图 2 所示不同结构实施了 5 次实验，旨在确定 ADS5483 通过一个开关稳压器直接运行时出现的性能降低情况。由于ADS5483 模拟 5-V 电源到目前为止表现出对电源噪声的最大敏感性，因此该研究忽略了 3.3-V 电源的噪声。ADS5483 产品说明书中列出的PSRR 支持这种情况：两个 3.3-V 电源的 PSRR 至少高出 5-V 模拟电源20 dB。
图 2 使用 ADS5483EVM 的 5 次实验电源结构
5 次实验的结构变化配置如下：
实验 1 —一个 5-V 实验室电源直接连接到 5-V 模拟输入，同时绕过开关稳压器(TPS5420) 和低噪声 LDO (TPS79501)。使用一个板上 LDO（TI 的 TPS79633）生成 ADS5483 低敏感度 3.3-V 模拟及数字电源的 3.3-V 电压轨。
实验 2 —将一个 10-V 实验室电源连接到 TPS5420 降压稳压器，其使用一个 5.3-V 输出。这样可为 TPS79501 提供一个 300-mV 压降，从而生成一个 5-V电压轨。
实验 3 —使用 TPS5420，从 10-V 实验室电源生成一个 5-V 电压轨。本实验中，我们绕过了TPS79501 低噪声 LDO。图 3a 表明，如“实验 2”连接的 LDO 较好地减少了开关稳压器的 5.3-V 输出峰值电压。但是，图 3b 表[url=]明[/url]5-VVDDA 电压轨铁氧体磁珠之后输出没有巨大的差异。
图3实验2（使用LDO）和实验3（无LDO）的示波器截图对比
实验 4 —本实验配置方法与“实验 3”相同，但去除了TPS5420 输出的 RC 缓冲器电路，其会引起高振铃和大开关频率杂散。
我们可在图 4 中清楚的观察到 RC 缓冲器电路的影响。去除 LDO 并没有在铁氧体磁珠之后表现出明显的差异，而[url=]去除[/url]RC 缓冲器电路则会导致更大的清洁5-VVDDA 电压轨电压峰值进入ADC。我们将在稍后详细研究RC 缓冲器电路的影响。
图 4 5-VVDDA 电压轨的电源噪声
实验 5 —将一个 8-Ω 功率电阻连接到 5-V 电源，模拟如现场可编程门阵列 (FPGA) 等额外负载。TPS5420 必须提供更高的输出电流，并更努力地驱动其内部开关，从而产生更大的输出杂散。通过重复进行“实验 2”、“实验 3”和“实验 4”可以测试这种配置。测量结果
我们利用输入信号频率扫描对比了5 个实验。先使用135 MSPS采样速率然后使用80 MSPS 采样速率对三个ADS5483EVM 实施了这种实验，均没有观察到巨大的性能差异。
在使用135-MSPS 采样速率情况下，SNR 和SFDR 的频率扫描如图5 所示。在10 到130MHz 输入频率下SNR 的最大变化约为0.1dB。SFDR 结果也非常接近；在某些输入频率（例如：80MHz）下，可以观测到下降1 至2 dB。
图 5 10 到 130MHz 输入频率扫描
5 个实验的 FFT 曲线图对比（请参见图 6）显示噪声底限或杂散振幅没有出现较大的增加。使用 LDO 清除开关噪声使得输出频谱看起来几乎与干净 5-V 实验室电源完全一样。去除 LDO 以后，我们观测到从开关稳压器产生了两个杂散，其具有一个来自 10-MHz 输入音调的约 500 kHz 频率偏置。RC 缓冲器电路降低这些杂散振幅约 3dB，从约 –108 dBc 降到了约 –111 dBc。这一值低于 ADS5483 的平均杂散振幅，其表明 ADS5483 可以在不牺牲 SNR 或 SFDR 性能的情况下直接由一个开关稳压器来驱动。
图 6 500-kHz 偏置杂散 65k-点 FFT 图
RC 缓冲器
降压稳压器输出能够以相当高的开关速度对非常大的电压实施开关操作。本文中，将 TPS5420 的输入电压轨设定为 10V，我们可以在输出端观测到许多过冲和振铃，如图 7a 所示。为了吸收一些电源电路电抗能量，我们将 RC 缓冲电路添加到了 TPS5420 的输出（请参见图 7b）。该电路提供了一个高频接地通路，其对过冲起到了一些阻滞作用。图 7a 表明 RC 缓冲器降低过冲约 50%，并且几乎完全消除了振铃。我选用了 R = 2.2Ω 和 C = 470 pF 的元件值。稳压器的开关频率范围可以为 500kHz 到约 6MHz，具体取决于制造厂商，因此可能需要我们对 R 和 C 值进行调节。这种解决方案的代价是带来一些额外的分流电阻 AC 功耗（尽管电阻非常的小），其降低稳压器总功效不足 1%。
图 7 TPS5420 开关稳压器
我们将 10MHz 输入信号标准化 FFT 图绘制出来，以对比“实验1”到“实验4”（请参见图 8）。TPS5420 的杂散在约 500kHz 偏置时清晰可见。缓冲器降低杂散振幅约 3dB，而低噪声 LDO 则完全消除了杂散。需要注意的是，RC 缓冲器（无 LDO）的杂散振幅约为 -112dBc，远低于 ADS5483 平均杂散振幅，因此 SFDR 性能并未[url=]降低[/url]。
图 8“实验 1”到“实验 4”的标准 FFT 图
在“实验 5”中，我们将一个 8-[url=]Ω[/url] 功率电阻添加到5-VVDDA 电压轨，旨在模拟电源的重负载。标准化 FFT 图（请参见图 9）并未显示出很多不同。去除 RC 缓冲器以后，杂散增加约 4.5dB；其仍然远低于平均杂散振幅。
图 9 添加 8-Ω 负载的标准化 FFT 图
CMOS 技术—ADS6148
当关注如何在保持较佳 SNR 和 SFDR 性能的同时尽可能地降低功耗时，我们一般利用 CMOS 技术来开发高速数据转换器。但是，CMOS 转换器的PSRR一般并不如 BiCOM ADC 的好。ADS6148 产品说明书列出了 25 dB 的 PSRR，而在模拟输入电源轨上 ADS5483 的 PSRR 则为 60dB。
ADS6148EVM 使用一种板上电源，其由一个开关稳压器 (TPS5420) 和一个低噪声、5-V 输出 LDO (TPS79501) 组成，后面是一些 3.3-V 和 1.8-V 电源轨的低噪声 LDO（请参见图 10）。与使用 ADS5483EVM 的 5 个实验类似，我们使用 ADS6148EVM 进行了下面另外 5 个实验，其注意力只集中在 3.3-VVDDA电压轨的噪声上面。1.8-VDVDD电压轨外置 TPS5420 实验表明对 SNR 和 SFDR 性能没有什么大的影响。
系统设计人员正面临越来越多的挑战，他们需要在不降低系统组件（例如：高速数据转换器）性能的情况下让其设计最大程度地节能。设计人员们可能会转而采用许多电池供电的应用（例如：某种手持终端、软件无线设备或便携式超声波扫描仪），也可能会缩小产品的外形尺寸，从而需要寻求减少发热的诸多方法。
极大降低系统功耗的一种方法是对高速数据转换器的电源进行优化。数据转换器设计和工艺技术的一些最新进展，让许多新型 ADC 可以直接由开关电源来驱动，从而达到最大化功效的目的。
系统设计人员们习惯在开关稳压器和 ADC 之间使用一些低噪、低压降稳压器 (LDO)，以清除输出噪声和开关频率谐波（请参见图 1）。但是，这种干净的电源设计的代价是[url=]高[/url]功耗，因为 LDO 要求压降余量来维持正常的运行。最低压降一般为 200 到 500mV，但在一些系统中其可以高达 1 到 2V（例如，ADC 的3.3-V 电压轨产生自一个使用 LDO 的 5V 开关电源时）。
图1从传统电源转到最大功效电源
就一个要求 3.3-V 电压轨的数据转换器而言，300mV 的 LDO 压降增加约 10% 的 ADC 功耗。这种效应在数据转换器中得到放大，因为它具有更小的工艺节点和更低的电源电压。例如，1.8V 时，相同 300-mV 压降增加约 17%（300 mV/1.8 V）的 ADC 功耗。因此，将该链的低噪声 LDO 去除可以产生巨大的节能效果。去除 LDO 还可以降低设计的板级空间、热量以及成本。
本文阐述了包括超高性能 16 位 ADC 在内的一些 TI 高速 ADC 可在 ADC 性能无明显降低的条件下直接通过开关稳压器驱动。为了阐述的方便，我们对两款不同的数据转换器（一款使用高性能BiCOM 技术（TI 的ADS5483），另一款使用低功耗CMOS 技术（TI 的ADS6148）进行了开关电源噪声敏感性研究。本文的其他部分对所得结果进行了一一介绍。
BiCOM 技术—ADS5483
这种工艺技术实现了宽输入频率范围下的高信噪比 (SNR) 和高无杂散动态范围 (SFDR)。BiCOM 转换器一般还具有许多片上去耦电容和非常不错的电源抑制比 (PSRR)。我们对 ADS5483 评估板 (ADS5483EVM) 进行了电源研究，其具有一个使用 TI TPS5420 开关稳压器 (Sw_Reg) 的板上电源；一个低噪声 LDO（TI 的 TPS79501）；以及一个外部实验室电源使用选项。我们使用图 2 所示不同结构实施了 5 次实验，旨在确定 ADS5483 通过一个开关稳压器直接运行时出现的性能降低情况。由于ADS5483 模拟 5-V 电源到目前为止表现出对电源噪声的最大敏感性，因此该研究忽略了 3.3-V 电源的噪声。ADS5483 产品说明书中列出的PSRR 支持这种情况：两个 3.3-V 电源的 PSRR 至少高出 5-V 模拟电源20 dB。
图 2 使用 ADS5483EVM 的 5 次实验电源结构
5 次实验的结构变化配置如下：
实验 1 —一个 5-V 实验室电源直接连接到 5-V 模拟输入，同时绕过开关稳压器(TPS5420) 和低噪声 LDO (TPS79501)。使用一个板上 LDO（TI 的 TPS79633）生成 ADS5483 低敏感度 3.3-V 模拟及数字电源的 3.3-V 电压轨。
实验 2 —将一个 10-V 实验室电源连接到 TPS5420 降压稳压器，其使用一个 5.3-V 输出。这样可为 TPS79501 提供一个 300-mV 压降，从而生成一个 5-V电压轨。
实验 3 —使用 TPS5420，从 10-V 实验室电源生成一个 5-V 电压轨。本实验中，我们绕过了TPS79501 低噪声 LDO。图 3a 表明，如“实验 2”连接的 LDO 较好地减少了开关稳压器的 5.3-V 输出峰值电压。但是，图 3b 表[url=]明[/url]5-VVDDA 电压轨铁氧体磁珠之后输出没有巨大的差异。
图3实验2（使用LDO）和实验3（无LDO）的示波器截图对比
实验 4 —本实验配置方法与“实验 3”相同，但去除了TPS5420 输出的 RC 缓冲器电路，其会引起高振铃和大开关频率杂散。
我们可在图 4 中清楚的观察到 RC 缓冲器电路的影响。去除 LDO 并没有在铁氧体磁珠之后表现出明显的差异，而[url=]去除[/url]RC 缓冲器电路则会导致更大的清洁5-VVDDA 电压轨电压峰值进入ADC。我们将在稍后详细研究RC 缓冲器电路的影响。
图 4 5-VVDDA 电压轨的电源噪声
实验 5 —将一个 8-Ω 功率电阻连接到 5-V 电源，模拟如现场可编程门阵列 (FPGA) 等额外负载。TPS5420 必须提供更高的输出电流，并更努力地驱动其内部开关，从而产生更大的输出杂散。通过重复进行“实验 2”、“实验 3”和“实验 4”可以测试这种配置。测量结果
我们利用输入信号频率扫描对比了5 个实验。先使用135 MSPS采样速率然后使用80 MSPS 采样速率对三个ADS5483EVM 实施了这种实验，均没有观察到巨大的性能差异。
在使用135-MSPS 采样速率情况下，SNR 和SFDR 的频率扫描如图5 所示。在10 到130MHz 输入频率下SNR 的最大变化约为0.1dB。SFDR 结果也非常接近；在某些输入频率（例如：80MHz）下，可以观测到下降1 至2 dB。
图 5 10 到 130MHz 输入频率扫描
5 个实验的 FFT 曲线图对比（请参见图 6）显示噪声底限或杂散振幅没有出现较大的增加。使用 LDO 清除开关噪声使得输出频谱看起来几乎与干净 5-V 实验室电源完全一样。去除 LDO 以后，我们观测到从开关稳压器产生了两个杂散，其具有一个来自 10-MHz 输入音调的约 500 kHz 频率偏置。RC 缓冲器电路降低这些杂散振幅约 3dB，从约 –108 dBc 降到了约 –111 dBc。这一值低于 ADS5483 的平均杂散振幅，其表明 ADS5483 可以在不牺牲 SNR 或 SFDR 性能的情况下直接由一个开关稳压器来驱动。
图 6 500-kHz 偏置杂散 65k-点 FFT 图
RC 缓冲器
降压稳压器输出能够以相当高的开关速度对非常大的电压实施开关操作。本文中，将 TPS5420 的输入电压轨设定为 10V，我们可以在输出端观测到许多过冲和振铃，如图 7a 所示。为了吸收一些电源电路电抗能量，我们将 RC 缓冲电路添加到了 TPS5420 的输出（请参见图 7b）。该电路提供了一个高频接地通路，其对过冲起到了一些阻滞作用。图 7a 表明 RC 缓冲器降低过冲约 50%，并且几乎完全消除了振铃。我选用了 R = 2.2Ω 和 C = 470 pF 的元件值。稳压器的开关频率范围可以为 500kHz 到约 6MHz，具体取决于制造厂商，因此可能需要我们对 R 和 C 值进行调节。这种解决方案的代价是带来一些额外的分流电阻 AC 功耗（尽管电阻非常的小），其降低稳压器总功效不足 1%。
图 7 TPS5420 开关稳压器
我们将 10MHz 输入信号标准化 FFT 图绘制出来，以对比“实验1”到“实验4”（请参见图 8）。TPS5420 的杂散在约 500kHz 偏置时清晰可见。缓冲器降低杂散振幅约 3dB，而低噪声 LDO 则完全消除了杂散。需要注意的是，RC 缓冲器（无 LDO）的杂散振幅约为 -112dBc，远低于 ADS5483 平均杂散振幅，因此 SFDR 性能并未[url=]降低[/url]。
图 8“实验 1”到“实验 4”的标准 FFT 图
在“实验 5”中，我们将一个 8-[url=]Ω[/url] 功率电阻添加到5-VVDDA 电压轨，旨在模拟电源的重负载。标准化 FFT 图（请参见图 9）并未显示出很多不同。去除 RC 缓冲器以后，杂散增加约 4.5dB；其仍然远低于平均杂散振幅。
图 9 添加 8-Ω 负载的标准化 FFT 图
CMOS 技术—ADS6148
当关注如何在保持较佳 SNR 和 SFDR 性能的同时尽可能地降低功耗时，我们一般利用 CMOS 技术来开发高速数据转换器。但是，CMOS 转换器的PSRR一般并不如 BiCOM ADC 的好。ADS6148 产品说明书列出了 25 dB 的 PSRR，而在模拟输入电源轨上 ADS5483 的 PSRR 则为 60dB。
ADS6148EVM 使用一种板上电源，其由一个开关稳压器 (TPS5420) 和一个低噪声、5-V 输出 LDO (TPS79501) 组成，后面是一些 3.3-V 和 1.8-V 电源轨的低噪声 LDO（请参见图 10）。与使用 ADS5483EVM 的 5 个实验类似，我们使用 ADS6148EVM 进行了下面另外 5 个实验，其注意力只集中在 3.3-VVDDA电压轨的噪声上面。1.8-VDVDD电压轨外置 TPS5420 实验表明对 SNR 和 SFDR 性能没有什么大的影响。
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