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DDR高速电路怎样更好的控制EMI呢?

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MID 的CPU 带有两个DDR2800M但在整机测试EMI 不加屏蔽的情况下过不了,请问大家在pcb Layout 的时有没有什么要改善的?

主要是针对EMI 测试,大家有没有什么好的见意?

帮顶!

注意差分时钟的布线,用地线包起来。
注意信号线的阻抗连续性,参考平面要注意。
信号的过冲厉害也会带来一定的EMI问题。

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