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这个问题难住了，只好发贴求救
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使用了MULTI CHANNEL设计(同一张原理图生成多个相同的模块），原理图中又包含了子图，设计中用到了总线，如FLASH_DATA[7..0]，编译里提示
Dulplicate Net Names Bus Slice FLASH_DATA[7..0]
难住了，向大侠们求救！
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