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Altium的bug？ 在隔壁看到的，试着做了下，真会报错，按照Altium的要求是没有问题的
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这是帖子的原文,照着做了下，编译报错，屏蔽后更新到PCB，有些网络更新不上去（网络名重复），觉得这就是Altium的bug,大家看看。
感觉在层次原理图的时候，默认情况下，网络标号作用域在本幅原理图，因此其它原理图中的同名网络标号和本图
Altium编译原理图，网络名应该在后台自动加上它所属的域 例如right.schdoc在Top层被引用（实例化）为原理图符号Right Side
那么编译时它里面的所有网络标号应该生成为 Right side.XXX 的形式
大家好，
有人可以做出以下的效果嗎?
不管我怎麼選 Net Identifier Scope -> Hierarchical
C1,C2 永遠都會出現 Duplicate Net Names Wire C1, Duplicate Net Names Wire C2
這是不是有Bug?
原文在這 http:// techdocs.altium.com/display/ADOH/Connectivity+and+Multi-Sheet+Design
感觉在层次原理图的时候，默认情况下，网络标号作用域在本幅原理图，因此其它原理图中的同名网络标号和本图
Altium编译原理图，网络名应该在后台自动加上它所属的域 例如right.schdoc在Top层被引用（实例化）为原理图符号Right Side
那么编译时它里面的所有网络标号应该生成为 Right side.XXX 的形式
大家好，
有人可以做出以下的效果嗎?
不管我怎麼選 Net Identifier Scope -> Hierarchical
C1,C2 永遠都會出現 Duplicate Net Names Wire C1, Duplicate Net Names Wire C2
這是不是有Bug?
原文在這 http:// techdocs.altium.com/display/ADOH/Connectivity+and+Multi-Sheet+Design
