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LVDS等长端点对控制(有上拉电阻时)

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如图,比如我们想控制从PHY到RJ45的LVDS信号等长。
此信号同时有接上拉电阻R,三个器件的布局如图。
那么在Allegro中,它会自动地将曼哈顿距离最长的端点对PHY-R来作为约束对象,这就和设计初衷相违背了。
我试了下pin-pair,好像在LVDS信号上是不能指定的。
哪位高手指点一下。谢谢!


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