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allegro导入netlist如何处理过孔
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请教各位大侠：如题，之前电源用的是VCC后来改为VDD再次产生netlist，然后PCB中import logic
可是网络变了，过孔的网络却没有变，怎么才能让过孔的网络变掉?
可是网络变了，过孔的网络却没有变，怎么才能让过孔的网络变掉?
帮顶，还有导入之后走线和shape的网络也没有跟着变，等高手解答
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