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ALLEGRO 16.6 为什么从原理图将网表导入PCB后，PCB中自己设置的规则都没有了？
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ALLEGRO 16.6 为什么从原理图将网表导入PCB后，PCB中自己设置的规则都没有了?
不能沉呀，问题还待解决呢?
明天帮你问问，这个我也不会。
等待 gvg525 的答案哦！
我最近也遇到了，明天我再问问
好像原理图含有规则，导出的网表也含规则，要改.log文件，规则项改no。
LS正解，你的原理图里面原来由于复制别的原理图，PCB回注等原因，本身包含了一些规则属性，但是你后来在PCB里面新加的规则又没有更新到原理图，重新导入网标时候，原理图里面的约束就会把PCB里面的覆盖掉。
那怎么样解决呢，不要把原理图里的规则带到PCB里呀
看看这样可以不。
