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allegro网表导入后已经被删除的网络名称怎么还在
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FPGA的供电vccint供电VCC1V0，更换电源芯片之后，使用了新的电源名称FPGA0_VCCINT，allegro导入新的网表之后，FPGA的电源引脚名称变为FPGA0_VCCINT，但是与之连接过孔的网络名称还是VCC1V0，我只能删除FPGA的扇出，重新做一遍电源引脚的扇出，请问有什么设置可以导入网表之后扇出过孔的网络名也更新为新的网络名称?Cadence版本为16.6
这是目前Allegro使用Fanout命令后的一个弊端，走线、过孔与零件绑定到一起了。
解决办法：
1、先将Fanout后的过孔、走线用Subdrawing导出，不勾选Preserve nets of vias;
2、删除Fanout后的过孔、走线，用Subdrawing导入；
后续导入网表就不会出现这样的问题了。
小编V5~~~~
佩服啊，学习了，谢谢小编的回答
