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求教下sigxplorer下的rel prop delay的设置？
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请教下，我在对ddr2的t型拓扑做等长设置的时候，在对AB和BC端设置等长的时候，我设置二个local规则ddr1_addr_m1,分别是AB和BC段，
但是这样只能保持一个信号线内的AB和BC等长，如果我需要这组线内的所有ABC段等长，是不是还要再设置一个从A端到B端的等长规则，是用
local还是global形式?
补充请教下，是否是local是指一根信号线内各部分的等长设置，而global指的是这组线各信号线之间的等长?
你的拓扑图画的跟你描述的好像不一致，A和C是ddr芯片，B是T点，D是CPU，对吗?
要分支等长应该是AB与BC等长，而不是AB与AC等长。
组内的线之间还要设两个等长，可以设组内线的DA等长、DC等长。
不好意思是我写错了
