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allegro怎样导入protel的网表?
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想用protel做原理图,用allegro做pcb,哪个高人给点建议?allegro版本15.7
好像论坛上有很多高人写的文章,不过好像对于15.7不好用呀,高人给点建议
看起来高手很多嘛,怎么没人回答?
Design---- Create Netlist
其中Output Format选择telesis输出,OK。
输出格式于Allegro有所不同,最好参照allegro的网表修改!
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