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ALLEGRO引脚交换的疑惑
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我试了一下FPGA的自动引脚交换功能,按照教材里面的方法,先在原理图工具下编辑PART,将FPGA的所有可用IO编成同一Pingroup,保存后生成网表导入ALLEGRO，在ALLEGRO界面下点击PLACE---AUTOSWAP----PARAMETERS----SWAP,点完之后,网络确实也交换了,但是交换完后网络还是有很多交叉,相比之下，AD6的引脚交换后网络就很顺畅，交叉基本没有了。请问是我的操作有问题吗，怎样可以在ALLEGRO中执行引脚交换后网络顺畅不交叉呢?
顶一下,望高手解答
没用过该功能
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